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示波器检验串行和并行总线设计

时间:2020-12-18 来源:计量校准 点击:次

示波器检验串行和并行总线设计
 
　　为了调试嵌入式系统，包括具有并行总线和串行总线的系统，集成示波器提供了各种实用工具，包括用于处理串行总线的协议分析器和用于处理并行总线的逻辑分析器。
　　在本例中，就串行而言，该设计使用了一个串行接口串行总线。由于这是一个简单的总线，示波器只需捕获构成串行接口串行总线的三个信号
　　在简单定义了数字阈值电平、串行信号配置等几个串行总线参数后，示波器自动解码总线数据，避免了手动解码总线数据，节省了几个小时，减少了昂贵的误差。
　　该串行接口串行总线驱动一个串并转换器。为了测试串行总线和并行总线，之间的时序关系，通过数字通道采集了8个并行总线信号。在定义了几个总线参数之后，平行的总线被自动解码和显示。示波器可以同时解码和显示多达两个并行总线或串行总线。通过同步显示两个总线，串行总线数据和并行总线数据之间的时序关系变得明显。在大多数情况下，传输串行数据包后，并行总线值将被设置为串行总线数据值。
　　为了简化调试任务，可以设置串行触发，稳定显示，捕捉特定的串行事件。在这种情况下，我们将触发器设置为每当十六进制数据值B0在串行总线如图3上传输时捕获信号，当十六进制串行值B0传输时，并行总线值不变。进一步调查表明，计量校准设计的工作模式与预期的工作模式存在较大差距。

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